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就昨天早上，上海 ISCAS 大会上华为发布了一新规律，叫“韬（τ）规律”，何庭波亲身讲的仍是。
然后这事儿就全网刷屏了，人民日报都出了专门报导，说它是我国在全球半导体范畴初次提出的辅导准则。
国外的彭博社、路透社也都立刻紧跟，发了文章介绍华为的新规律，说华为宣告芯片技能取得了打破，将缩小与台积电的距离。
不过光听这宣扬，想必不少差友跟我相同振作完了都开端揣摩，你这玩意听着很吊，但它到底是干啥的呢？
哥们儿今一天也是没闲着，专门把人家这讲演，技能白皮书，乃至把华为刚揭露的一份芯片专利都翻了一遍。
看完之后吧，emmm怎样说呢，这事的确是真挺强的，但也没有某些自媒体吹的那么离谱。
精确说它或许也不应叫规律，而更像一套工程方法论，一个新的坐标系。但它也是我国芯片在往前冲的过程中，总结出的名贵的体系化干货。
1965年，英特尔的戈登摩尔猜测集成电路上的晶体管数每两年翻一番。这个猜测后来变成了整个半导体工业的开展节拍，一切人按这个节奏走了几十年。道理很简略，晶体管越小，运算越快，也就更省电更廉价。
由于这就比方一裤衩子，小到某些特定的程度电子就兜不住了，兜不住就窜，然后就漏电，电压下不去。持续缩小不是不可，但功能前进越来越有限。
完事儿这玩意还费钱，造一颗2纳米级其他芯片，光规划本钱几亿美元起步，再加十几亿的EUV光刻机折旧，摊到每片晶圆上，单位晶体管本钱有时候反而更贵了。
这个其实是等效制程，尽管物理上的确做不下去了，但通过通过种种骚操作，改进工艺规划、优化结构，功能上仍是能前进的，把前进后的功能等效成摩尔规律算出来的数字就行了。
至于无法等效的，也通过封装技能来尽量拉高功能，比方AMD搞大芯片拆分的Chiplet，苹果M系列上也用了一致内存架构，我们是各有各的高着儿。
但问题就在这：我们的招都不相同啊，你说你等效3纳米，他说他等效2纳米，你俩怎样比呢？
只看尺度的老传统，其实早就名存实亡了。整个职业在摩尔规律之后，其实一向缺一把新尺子。
说到τ规律，τ这样的一个东西其实不难理解，便是信号从一种状况切换到另一种状况需求的时刻，
τ越小，0和1切得越快，频率越高，芯片就越快。所以这摩尔规律说白了，实质也是靠缩小晶体管尺度，平等面积里塞进更多核算单元，来让运算时刻变短，前进功率。
比方在器材层，τ可所以晶体管自身的开关推迟，靠优化沟道资料、栅极结构来紧缩。 而在电路层，τ则是逻辑门之间的信号传达推迟，靠缩短走线、下降RC负载来优化。
至于在芯片上，τ主要指片上网络和存储拜访推迟，靠高带宽内存、近存核算来削减。在最终的体系层面，芯片与芯片之间的通讯推迟也是τ，靠光互连、一致总线架构能够缩短。
这四层不是各优化各的，而是协同联动，上一层的τ改进能够开释下一层的瓶颈。
用何庭波论文原话说便是，这是自登纳德缩放规律以来，首个在整个核算栈树立一致优化方针的缩放原理
出产经历标明，关于功耗受限的移动电子设备，a约为每年1.3倍；关于安全要害型自主体系，约为每年1.5倍；而关于人工智能作业负载，由于吞吐量直接转化为经济价值，a可高达每年10倍。
总结便是，τ规律不是华为忽然发明晰什么黑科技，而是给职业里现已存在的各种技能找了一个一致的解说结构和优化坐标。
管你是什么先进制程、3D堆叠、仍是HBM、光互连，只需能削减要害等待时刻的，都是在优化τ。
但本年下半年的新一代麒麟芯片，方针直接拉到了3.1GHz，2029年方针到了4GHz。咱就单从纵向上比较，能够说这τ规律的确发功了，的确有前进。
当然也得说清楚的是，哪怕到了2029年，4GHz峰值频率和苹果A19 Pro的4.26GHz仍是有距离的。
然而在没有EUV光刻机、被制裁Debuff叠满的条件下，这个前进速度自身也值得表彰。
依照华为的说法，他们能完成这个提速靠的是LogicFolding逻辑折叠技能。
简略来说，传统芯片根本就像一张摊开的山东煎饼，一切逻辑单元都铺在同一个平面上。门电路A要跟B通讯，就得在平面上拉线。
把本来摊在一个面上的逻辑电路，折到上下两层乃至更多层里去，本来需求绕一大圈的线，现在直接坐电梯，线变短了，信号等待时刻就少了，功耗也跟着降，怎样折都省电。
按官方数据，光靠这一手折叠，在没换工艺的情况下，新一代麒麟芯片的晶体管密度从155 MTr/mm跳到了238 MTr/mm，P核能效前进41%，最高频率前进13%。道路nm。
不过一位芯片职业的工程师向我们介绍说，由于华为的晶体管密度核算算法和职业干流有所差异，换算过来大约对应台积电5纳米到3纳米之间的水平，跟三星3纳米有的一比，暂时还比不过台积电的3纳米。
原商汤智能工业研究院院长田丰在承受各个媒体采访时就说到，RC推迟自身是半导体物理里的常见概念，Intel、台积电、三星的先进封装道路，同样在紧缩互连RC推迟。
台积电的SoIC、Intel的Foveros、三星的X-Cube，实质上也都是在想方法用堆叠缩短信号的等待时刻。即使技能细节不相同，也阐明不是只要华为一家在做折叠。
说白了，后摩尔年代我们都意识到光卷纳米数不行用了，各家其实都在往相似的方向摸，但要害是此前没有人专门把它提炼出来，站在IEEE的讲台上喊一喉咙说这是个规律。
原理，它的奉献在于把职业里现已存在的这些方向，体系化成了一个一致的结构。
至于姓名应不应该叫规律，那我觉得其实也不重要（由于摩尔规律严格来说也不算规律而是经历），重要的是这个思路自身成不成立。
说实话，华为被制裁六年，没有EUV光刻机，在有限工艺上硬是把封装架构、跨层布局、散热办理、供电分配、体系协同这些内功练了出来，量产了381款芯片，覆盖了手机、AI、轿车、一众基础设施。
并且假如未来有一天EUV光刻机真搞出来了，麒麟芯片的底座能换成更先进的工艺，到时候华为现已练了好几年了内功或许才会真实开释出来。
除了这些，τ这样的一个东西吧，它真实凶猛的当地或许不在技能，而是有点去中心化，把我们从摩尔规律的思维钢印里解放出来。
曾经我们都环绕制程纳米数这一个目标卷生卷死，卷到后来这一个数字跟实践现已脱节了，还要用模仿的数字来算目标，这不诙谐嘛。
而在这个τ结构下，每个场景按自己的需求优化τ，这比一切人都只卷纳米数更实践。并且这个思路假如被职业承受，长时间影响会比任何一项详细的技能都大。
总归，半导体这个职业，历来不是只要一条路能够走。在一切人都在探索后摩尔年代方向的阶段，能拿出一套体系化答案自身，就现已是一种才能了。
有了清晰的理论方向，有了通过量产查验的技能道路，我们拧成一股绳往一个方向用力，我们的芯片工业或许还能迸发出不少人幻想不到的潜力。
